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[新闻动态]高速串行链路参考Crystal Oscillator相噪评估2019年07月18日 10:10: 锁相环(PLL)是许多数字和RF系统中的基本构建模块.图1a显示了一个示例PLL,其相位检测器比较相应的输入和反馈边沿,并输出与其相位差成比例的脉冲,然后对其进行滤波以控制VCXO振荡器.在此示例中,相位检测器在其上升沿中点对其输入进行采样.因此,平均采样(FS)和输入时钟频率(FIN)是相等的.抖动的频谱分量位于奈奎斯特频率(FS/2)以上,或者在采样后折回,低于奈奎斯特频率.图1b说明了PLL抖动传递函数,其低通滤波特性在奈奎斯特频率FS/2的整数倍频谱范围内镜像.在奈奎斯特频率以下,落在PLL环路带宽内的抖动频率无衰减,而落在该带宽之外的抖动频率会因环路的响应而衰减.图1c使用对数x轴绘制具有5MHz闭环带宽的PLL的类似传递函数.该图是任意绘制到1GHz.; 阅读（703）标签：

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